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EnglishSystem-Level Modeling of an ATM Node in VHDL / CORNERO M; MARCHESE M; CHIRICO M; F. CURATELLI. - STAMPA. - (1994), pp. 41-51. ((Intervento presentato al convegno Fall'94 Meeting of the VHDL Forum for CAD in Europe tenutosi a Grenoble, France nel September 1994.
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http://hdl.handle.net/11567/202166| Titolo: | System-Level Modeling of an ATM Node in VHDL |
| Autori interni: | MARCHESE, MARIO CURATELLI, FRANCESCO |
| Data di pubblicazione: | 1994 |
| Handle: | http://hdl.handle.net/11567/202166 |
| Appare nelle tipologie: | 04.01 - Contributo in atti di convegno |
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